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Graba, Tarik

institut polytechnique de paris

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收录论文 1
发表时间
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High Throughput/Gate AES Hardware Architectures Based on Datapath Compression基于数据路径压缩的高吞吐量/门AES硬件架构
errIEEE TRANSACTIONS ON COMPUTERS
IF3.8
err2020-04-01
err21
errOAAI
errUeno, Rei; Homma, Naofumi; Morioka, Sumio; Miura, Noriyuki; Matsuda, Kohei; Nagata, Makoto; Bhasin, Shivam; Mathieu, Yves; Graba, Tarik; Danger, Jean-Luc
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研究方向

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合作学者
合作期刊
M
Makoto Nagata
H 指数: 44 · 论文数: 949
S
Sumio Morioka
H 指数: 15 · 论文数: 50
R
Rei Ueno
H 指数: 14 · 论文数: 82
M
Miura, Noriyuki
H 指数: 0 · 论文数: 1
B
Bhasin, Shivam
H 指数: 0 · 论文数: 2
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